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File:MIPS Architecture (Pipelined).svg

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原始檔案 ‎（SVG 檔案，表面大小：800 × 500 像素，檔案大小：56 KB）

摘要

描述
English: The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).
日期
來源 自己的作品
作者 Inductiveload
授權許可
(重用此檔案)
Public domain 我，此作品的版權所有人，釋出此作品至公共領域。此授權條款在全世界均適用。
這可能在某些國家不合法，如果是的話：
我授予任何人有權利使用此作品於任何用途，除受法律約束外，不受任何限制。
其他版本 rkrkgkf
SVG開發
InfoField
 
本SVG檔案的原始碼無效，因為出現1個錯誤。
 
本向量圖形使用Inkscape創作。
 
這個SVG 檔案使用了內置文字，可以輕鬆翻譯。

說明

添加單行說明來描述出檔案所代表的內容
带有流水线的MIPS微处理器的逐级结构。虽然为了使流水线清晰，内存显示了两次，但MIPS架构只有一个内存库（即冯-诺依曼架构）。

在此檔案描寫的項目

描繪內容

檔案來源 Chinese (Taiwan) (已轉換拼寫)

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檔案歷史

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日期/時間縮⁠圖尺寸使用者備⁠註
目前2009年1月22日 (四) 17:08於 2009年1月22日 (四) 17:08 版本的縮圖800 × 500（56 KB）Inductiveload{{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So
2009年1月22日 (四) 17:08於 2009年1月22日 (四) 17:08 版本的縮圖800 × 500（56 KB）Inductiveload{{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So

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全域檔案使用狀況

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詮釋資料

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取自「https://zh.wikipedia.org/wiki/File:MIPS_Architecture_(Pipelined).svg」